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인텔® E7500 칩셋

인텔® E7500 칩셋

볼륨 칩셋인 인텔® E7500 칩셋은 512KB L2 캐시 및 인텔 넷버스트® 마이크로아키텍처 기반의 인텔® 제온® 프로세서에 최적화된 듀얼 프로세서(DP) 서버 시스템을 지원합니다. 인텔 E7500 칩셋 설계는 극대화된 시스템 버스, 메모리 및 I/O 대역폭을 제공하여 성능, 확장성 및 최종 사용자 생산성을 향상시키는 한편, 차세대 서버 기술로 원활하게 전환할 수 있도록 도와줍니다.

 기능 및 이점
이중 처리 서버 시스템을 위해 512KB L2 캐시가 포함된 인텔® 제온® 프로세서를 지원합니다. 인텔® 제온® 프로세서의 인텔 넷버스트® 마이크로아키텍처 및 하이퍼 스레딩 기술을 통해 서버의 최대 작업 부하에서 동급 최고의 성능을 제공하는 플랫폼을 구현합니다.
400MHz 시스템 버스 기능 더 많은 메모리 및 I/O 대역폭을 지원할 수 있는 3.2GB/s 시스템 버스 대역폭을 통해 균형 잡힌 고성능 플랫폼을 지원합니다.
MCH에 연결되는 인텔® 허브 아키텍처 2.0 MCH와 3개의 P64H2 장치 사이의 이 지점 간 연결은 1GB/s 이상의 대역폭을 제공합니다. ECC(Error Code Correction) 보호는 고속 데이터 전송률과 함께 고속 네트워크에 대한 더욱 빠른 액세스 및 향상된 신뢰성으로 I/O 세그먼트를 지원합니다.
64비트 PCI/PCI-X 컨트롤러 허브-2 차세대 PCI/PCI-X 성능을 도입하고 플랫폼 유연성을 크게 향상시킵니다. 각 P64H2에 대한 2개의 독립된 64비트 133MHz PCI-X 세그먼트와 2개의 핫플러그 컨트롤러(세그먼트당 1개)는 시스템당 최대 6개의 PCI-X 버스를 지원합니다.
듀얼 채널 DDR-200 메모리 인터페이스 최대 밀도가 512Mb인 144비트급 200MHz DDR(Double Data Rate) SDRAM 메모리 인터페이스를 통해 3.2GB/s의 최대 메모리 대역폭을 제공합니다.
고급 플랫폼 RASUM 메모리 ECC(Error Correction Code), 인텔® x4 SDDC(Single Device Data Correction), 하드웨어 메모리 스크러빙, MCH SMBus 대상 인터페이스, 허브 인터페이스 ECC, 재설정을 통해 유지 관리되는 향상된 오류 상태 정보 등의 기능으로 보다 안정적인 플랫폼을 제공합니다.

추가 정보: 1 2

패키징 정보

E7500 메모리 컨트롤러 허브(MCH)

파일 형식/크기: PDF 2131KB

1005 플립 칩 볼 그리드 어레이(FC-BGA)

82801CA 통합 컨트롤러 허브(ICH3-S)

파일 형식/크기: PDF 2193KB

인텔(R) 82801CA I/O 컨트롤러 허브 3(ICH3-S) 사양 업데이트

421 볼 그리드 어레이(BGA)

82870P2 64비트 PCI/PCI-X 컨트롤러(P64H2)

파일 형식/크기: PDF 1610KB

567 플립 칩 볼 그리드 어레이(FC-BGA)

제품 및 성능 정보

open

1. 인텔® 하이퍼스레딩 기술(인텔® HT 기술) 지원 시스템이 필요합니다. PC 제조사에 문의하십시오. 성능은 하드웨어 및 소프트웨어 구성에 따라 달라집니다. 인텔® 코어™ i5-750에서 사용할 수 없습니다. HT 기술을 지원하는 프로세서에 대한 세부 사항을 포함한 자세한 내용은 http://www.intel.com/content/www/us/en/architecture-and-technology/hyper-threading/hyper-threading-technology.html을 참조하십시오.

2. x4 DDR 메모리 장치에서 인텔® x4 단일 장치 데이터 보정(인텔® x4 SDDC)은 해당 단일 장치 내에서 1, 2, 3, 4개 데이터 비트에 대해 오류 검색 및 보정 기능을 제공하며 2개 장치 내에서 최대 8개 데이터 비트에 대해 오류 검색 기능을 제공합니다.