PCI Express*용 다중 채널 DMA 인텔 FPGA IP

PCI Express용 다중 채널 DMA IP는 HPC, 클라우드, 네트워킹에서 임베디드에 이르는 다양한 애플리케이션을 지원하는 높은 효율성, 속도 및 구성 유연성을 제공합니다. 최대 2,048개 채널 및 Linux 기반 PCIe 드라이버를 지원하는 이 저지연, 저자원 솔루션은 시스템 성능을 최적화하기 위해 대량의 데이터 이동을 처리하는 데 필수적입니다.

PCI Express*용 다중 채널 DMA 인텔 FPGA IP

1. Agilex™ 5 FPGA – AXI Multichannel DMA 구매 가능

  • AXI-Stream 사용자 로직 인터페이스

2. Agilex™ 7 FPGA – 사용자 인터페이스 선택에 따라 2개의 다중 채널 DMA를 사용할 수 있습니다.

  • Avalon® 메모리 매핑 또는 Avalon® 스트리밍 사용자 로직 인터페이스
  • AXI-Stream 사용자 로직 인터페이스

다중 채널 DMA IP는 위에서 언급한 다양한 사용자 로직 인터페이스를 제공할 뿐만 아니라 PCI-SIG* 호환 PCI Express 하드 IP와 함께 전체 통합을 간소화하고 설계 주기를 단축합니다.

DMA는 호스트 대 장치(H2D) 및 장치 대 호스트(D2H) 대기열 쌍으로 구성된 채널로 구성됩니다. 그림에서 볼 수 있듯이 다중 채널 DMA는 서버의 하드웨어 인프라에서 다양한 VM(가상 머신) 기반 클라이언트와 해당 FPGA 디바이스 기반 클라이언트 간의 통신을 허용하는 데 사용할 수 있습니다. DMA는 FPGA와 호스트 간에 데이터를 전송하기 위해 Linux 드라이버에 의해 설정된 설명자 기반 대기열에서 작동합니다. 큐가 채워지면 제어 논리는 큐 설명자를 읽고 실행합니다. 실행되면 DMA는 트랜잭션 완료를 기록하기 위해 인터럽트를 제공합니다.

PCI Express 시스템 수준 솔루션을 구축할 때 PCIe 하드 IP를 사용하는 다중 채널 DMA IP는 루트 포트(RP) 및 엔드포인트(EP) 토폴로지를 모두 지원합니다. 이러한 유형의 구성 호환성과 유연성은 임베디드에서 엔터프라이즈에 이르는 다양한 플랫폼에 원활한 통합을 가능하게 합니다.

IP Quartus® Prime 디자인 소프트웨어에 포함 주문 코드

Agilex™ 5 FPGA – PCI Express용 AXI 다중 채널 DMA 인텔 FPGA IP

(AXI-Stream 인터페이스)

 아니요 IP-PCIEMCDMA-AXI-AG5

Agilex™ 7 FPGA – PCI Express용 AXI 다중 채널 DMA 인텔 FPGA IP

(AXI-Stream 인터페이스) (R-타일과 함께 사용 가능)

 아니요 IP-PCIEMCDMA-AXI
Agilex™ 7 및 Stratix® 10 FPGAs – PCI Express(AVMM/AVST 인터페이스)용 다중 채널 DMA 인텔 FPGA IP(H-타일(Stratix® 10), P-타일, F-타일 및 R-타일과 함께 사용 가능) 아니요 IP-PCIEMCDMA
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  • 애플리케이션 인터페이스 옵션: AXI-Stream, Avalon 메모리 매핑 또는 Avalon 스트리밍
  • Agilex™ 7 FPGA DMA 기능
• 데이터 버스 폭 옵션: 256, 512, 1024
• 최대 PCIe 5.0 x16 지원
• 최대 2048개 채널 구성 가능
• SR-IOV 지원(8개의 PF, 2048개의 VF)
  • Agilex™ 5 FPGA DMA 기능
• 데이터 버스 폭 옵션: 128, 256
• 최대 PCIe 4.0 x8 지원
• 최대 8개 채널 구성 가능(향후 Quartus 릴리스에서 최대 256개 채널)
• SR-IOV 지원(1PF, 8VF)(향후 Quartus 릴리스에서 최대 4PF/256VF)
  • 루트 포트 또는 엔드포인트 구성 가능성
  • DMA 작업을 위한 통합 MSI-X 인터럽트
  • 적절한 트랜잭션 추적 및 관리를 보장하기 위해 DMA 수준에서 10비트 태그 지원
  • 완료 재정렬 및 완료 시간 초과 지원
  • 모든 채널에서 헤드 오브 라인 차단을 방지하도록 설계

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