JESD204B/JESD204C 인텔® FPGA IP 코어 – 지원 센터
JESD204B/C 인텔® FPGA IP 코어 지원 센터는 JESD204B/C 링크를 선택, 설계 및 구현하는 방법에 대한 정보를 제공합니다. 시스템을 가져오고 JESD204B/C 링크를 디버깅하는 방법에 대한 지침도 있습니다. 이 페이지는 처음부터 끝까지 JESD204B/C 시스템 설계 흐름에 맞는 범주로 구성됩니다.
아래 페이지에서 인텔 Agilex 7, 인텔® Stratix® 10, 인텔 Arria® 10, 인텔 Cyclone® 10개 장치에 대한 지원 리소스를 확인하십시오. 기타 장치의 경우 문서 아카이브, 교육 과정, 비디오 및 웹캐스트, 설계 예 및 지식 자료와 같은 링크를 검색하십시오.
시작
1. 장치 및 IP 선택
어떤 인텔® FPGA 가족을 사용해야 합니까?
표 1 - JESD204B 인텔® FPGA IP 코어 성능
장치 제품군 | PMA 속도 등급 | FPGA 패브릭 속도 등급 | 데이터 속도 | 링크 클럭 fMAX(MHz) | |
---|---|---|---|---|---|
하드 PCS 활성화(Gbps) | 소프트 PCS(Gbps) 활성화 1 | ||||
® 인텔 Agilex 7(F-Tile) | 1 | -1 | 지원되지 않음 | 2.0 ~ 20.0 | data_rate/40 |
-2 | 지원되지 않음 | 2.0 ~ 19.2 | data_rate/40 | ||
2 | -2 | 지원되지 않음 | 2.0 ~ 19.2 | data_rate/40 | |
-3 | 지원되지 않음 | 1.0 ~ 16.7 | data_rate/40 | ||
3 | -3 | 지원되지 않음 | 2.0 ~ 16.7 | data_rate/40 | |
® 인텔 Agilex 7(E-Tile) | 2 | -2 | 지원되지 않음 | 2.0 ~ 17.4 | data_rate/40 |
3 | -2 | 지원되지 않음 | 2.0 ~ 17.4 | data_rate/40 | |
-3 | 지원되지 않음 | 2.0 ~ 16.0 | data_rate/40 | ||
인텔® Stratix® 10(L-Tile 및 H-Tile) | 1 | 1 | 2.0 ~ 12.0 | 2.0 ~ 16.02 | data_rate/40 |
2 | 2.0 ~ 12.0 | 2.0 ~ 14.0 | data_rate/40 | ||
2 | 1 | 2.0 ~ 9.83 | 2.0 ~ 16.02 | data_rate/40 | |
2 | 2.0 ~ 9.83 | 2.0 ~ 14.0 | data_rate/40 | ||
3 | 1 | 2.0 ~ 9.83 | 2.0 ~ 16.02 | data_rate/40 | |
2 | 2.0 ~ 9.83 | 2.0 ~ 14.0 | data_rate/40 | ||
3 | 2.0 ~ 9.83 | 2.0 ~ 13.0 | data_rate/40 | ||
인텔® Stratix® 10(E-Tile) | 1 | 1 | 지원되지 않음 | 2.0 ~ 16.02 | data_rate/40 |
2 | 지원되지 않음 | 2.0 ~ 14.0 | data_rate/40 | ||
2 | 1 | 지원되지 않음 | 2.0 ~ 16.02 | data_rate/40 | |
2 | 지원되지 않음 | 2.0 ~ 14.0 | data_rate/40 | ||
3 | 3 | 지원되지 않음 | 2.0 ~ 13.0 | data_rate/40 | |
인텔® Arria® 10 | 1 | 1 | 2.0 ~ 12.0 | 2.0 ~ 15.0 2 3 | 데이터 속도/40 |
2 | 1 | 2.0 ~ 12.0 | 2.0 ~ 15.0 2 3 | 데이터 속도/40 | |
2 | 2.0 ~ 9.83 | 2.0 ~ 15.0 2 3 | 데이터 속도/40 | ||
3 | 1 | 2.0 ~ 12.0 | 2.0 ~ 14.2 2 4 | 데이터 속도/40 | |
2 | 2.0 ~ 9.83 | 2.0 ~ 14.2 2 5 | 데이터 속도/40 | ||
4 | 3 | 2.0 ~ 8.83 | 2.0 ~ 12.56 | 데이터 속도/40 | |
인텔® Cyclone® 10GX | <지원 속도 등급이 지원됨> | <지원 속도 등급이 지원됨> | 2.0 ~ 6.25 | 2.0 ~ 6.25 | 데이터 속도/40 |
표 2 - JESD204C 인텔® FPGA IP 코어 성능
장치 제품군 | PMA 속도 등급 | FPGA 패브릭 속도 등급 | 데이터 속도 | 링크 클럭 fMAX(MHz) | |
---|---|---|---|---|---|
하드 PCS 활성화(Gbps) | 소프트 PCS 활성화(Gbps) | ||||
® 인텔 Agilex 7(F-Tile) | 1 | -1 | 지원되지 않음 | 5~ 32.44032 | data_rate/40 |
-2 | 지원되지 않음 | 5~ 32.44032* | data_rate/40 | ||
2 | -1 | 지원되지 않음 | 5~28.8948* | data_rate/40 | |
-2 | 지원되지 않음 | 5~28.8948* | data_rate/40 | ||
-3 | 지원되지 않음 | 5~24.33024 | data_rate/40 | ||
3 | -3 | 지원되지 않음 | 5~17.4 | data_rate/40 | |
® 인텔 Agilex 7(E-Tile) | 1 | -1 | 지원되지 않음 | 5~28.9 | data_rate/40 |
2 | -2 | 지원되지 않음 | 5~ 28.3 | data_rate/40 | |
-3 | 지원되지 않음 | 5~25.6 | data_rate/40 | ||
3 | -2 | 지원되지 않음 | 5~17.4 | data_rate/40 | |
-3 | 지원되지 않음 | 5~17.4 | data_rate/40 | ||
인텔® Stratix® 10(E-Tile) | 1 | -1 | 지원되지 않음 | 5~28.9 | data_rate/40 |
-2 | 지원되지 않음 | 5~25.6 | data_rate/40 | ||
2 | -1 | 지원되지 않음 | 5~ 28.3 | data_rate/40 | |
-2 | 지원되지 않음 | 5~25.6 | data_rate/40 | ||
3 | -1 | 지원되지 않음 | 5~17.4 | data_rate/40 | |
-2 | 지원되지 않음 | 5~17.4 | data_rate/40 | ||
-3 | 지원되지 않음 | 5~17.4 | data_rate/40 |
1. 소프트 PCS 활성화를 선택하여 최대 데이터 속도를 달성하십시오. TX IP 코어의 경우 소프트 PCS를 활성화하면 리소스 사용률이 3~8% 더 증가합니다. RX IP 코어의 경우 소프트 PCS를 활성화하면 리소스 사용률이 10~20% 더 증가합니다.
2. 트랜시버 속도 등급 및 트랜시버 전원 공급 장치 작동 조건에서 지원되는 최대 데이터 속도는 인텔 Arria 10 및 인텔 Stratix 10 장치 데이터시트를 참조하십시오.
3. 15.0Gbps에서 소프트 PCS 모드를 사용할 경우 타이밍 여백이 매우 제한적입니다. 타이밍 성능을 개선하기 위해 높은 적합성 노력을 활성화하고 중복을 등록하고 리티밍을 등록하는 것이 좋습니다.
4. 인텔 Arria 10GX 160, SX 160, GX 220 및 SX 220 장치의 경우 지원되는 데이터 속도는 최대 12.288Gbps입니다.
5. 인텔 Arria 10GX 160, SX 160, GX 220 및 SX 220 장치의 경우 지원되는 데이터 속도는 11.0Gbps입니다.
6. 인텔 Arria 10GX 160, SX 160, GX 220 및 SX 220 장치의 경우 지원되는 데이터 속도는 10.0Gbps입니다.
2. 설계 흐름 및 IP 통합
IP 통합에 대한 정보는 어디에서 찾을 수 있습니까?
® 인텔 Agilex 7 장치
- AN 901: 인텔 Agilex 7 FPGA® E-Tile JESD204C RX IP를 탑재한 아날로그-디지털 컨버터 듀얼 링크 디자인 구현
- AN 967: 디지털 위상 배열 시스템의 다중 장치 동기화
인텔® Stratix® 10 장치
- AN804: 인텔 Stratix 10 JESD204B RX IP 코어로 동기화된 ADC 멀티 링크 설계 구현
- AN804: 인텔 Stratix 10 JESD204B RX IP 코어를 탑재한 비동기 ADC 멀티 링크 설계 구현
® 인텔 Arria 10 장치
3. 보드 설계 및 전력 관리
핀 연결 지침
® 인텔 Agilex 7 장치
인텔® Stratix® 10 장치
인텔® Arria® 10 장치
인텔® Cyclone® 10 장치
도식 검토
® 인텔 Agilex 7 장치
인텔 Stratix 10 장치
인텔 Cyclone 10 장치
인텔 Arria 10 장치
열 전력 관리
® 인텔 Agilex 7 장치
인텔® Stratix® 10 장치
전원 시퀀싱
® 인텔 Agilex 7, 인텔® Stratix® 10, 인텔® Cyclone® 10, 인텔® Arria® 10 장치
4. 상호 운용성 및 표준 테스트
JESD204B 인텔 FPGA IP 하드웨어 체크아웃 보고서
® 인텔 Agilex 7 장치
- AN 976: 7개의 F-Tile 장치에 인텔 Agilex® 대한 JESD204C 인텔® FPGA IP 및 ADI AD9081 MxFE* DAC 상호 운용성 보고서
- AN 876: 인텔® AGILEX™ F-Tile 장치에 대한 JESD204C 인텔® FPGA IP 및 ADI AD9081 MxFE* ADC 상호 운용성 보고서
- AN 960: JESD204C 인텔® FPGA IP 및 ADI AD9081 MxFE* ADC 상호 운용성 보고서 인텔 Agilex® 7개의 E-Tile 장치
인텔® Stratix® 10 장치
JESD204B
- AN 905: 인텔 Stratix 10개 장치에 대한 JESD204B 인텔® FPGA IP® 및 ADI AD9213 상호 운용성 보고서
- AN 915: 인텔 STRATIX 10개의 E-타일 장치에 대한 JESD204B 인텔® FPGA IP® 및 ADI AD9208 상호 운용성 보고서
- AN 890: 인텔 STRATIX 10L-Tile 장치에 대한 JESD204B 인텔® FPGA IP® 및 ADI AD9174 상호 운용성 보고서
- AN 823: 인텔 Stratix 10개 장치에 대한 JESD204B IP 코어 및 ADI AD9625 하드웨어 체크아웃 보고서 인텔 FPGA
- AN 832: 인텔 FPGA JESD204B IP 코어 및 ADI AD9208 하드웨어 체크아웃 보고서 인텔 Stratix 10개 장치
- AN 833: 인텔® Stratix 10GX® 16 레인 RX JESD204B-ADC12DJ3200 상호 운용성 참조 설계
JESD204C
- AN 909: JESD204C 인텔® FPGA IP 및 TI ADC12DJ5200RF 인텔® Stratix® 10 장치 상호 운용성 보고서
- AN 916: JESD204C 인텔® FPGA IP 및 ADI AD9081/AD9082 MxFE* 인텔® Stratix® 10개의 E-타일 장치에 대한 상호 운용성 보고서
- AN 927: JESD204C 인텔® FPGA IP 및 ADI AD9081 MxFE* ADC 상호 운용성 보고서 인텔® Stratix® 10개의 E-Tile 장치
- AN 949: 인텔® STRATIX® 10개의 E-타일 장치에 대한 JESD204C 인텔® FPGA IP 및 ADI AD9081 MxFE* DAC 상호 운용성 보고서
인텔® Arria® 10 장치
- AN 710: 인텔 FPGA JESD204B 메가코어 기능 및 ADI AD9680 하드웨어 체크아웃 보고서
- AN 712: 인텔 FPGA JESD204B 메가코어 기능 및 ADI AD9625 하드웨어 체크아웃 보고서
- AN 749: 인텔 FPGA JESD204B IP 코어 및 ADI AD9144 하드웨어 체크아웃 보고서
- AN 753: 인텔 FPGA JESD204B IP 코어 및 ADI AD6676 하드웨어 체크아웃 보고서
- AN 779: 인텔 FPGA JESD204B IP 코어 및 ADI AD9691 하드웨어 체크아웃 보고서
- AN 785: 인텔 FPGA JESD204B IP 코어 및 ADI AD9162 하드웨어 체크아웃 보고서
- AN 792: 인텔 FPGA JESD204B IP 코어 및 ADI AD9371 하드웨어 체크아웃 보고서
- AN 810: 인텔 FPGA JESD204B IP 코어 및 ADI AD9208 하드웨어 체크아웃 보고서
5. 설계 예 및 참조 디자인
표 -3: 통합 JESD204B/C 리소스
JESD204B 인텔® FPGA IP | JESD204C 인텔® FPGA IP | F-Tile JESD204C 인텔® FPGA IP | F-Tile JESD204B 인텔® FPGA IP | ||
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IP 사용자 가이드 | 일반 | JESD204B 인텔® FPGA IP 사용자 가이드 | JESD204C 인텔® FPGA IP 사용자 가이드 | F-Tile JESD204C 인텔® FPGA IP 사용자 가이드 | F-Tile JESD204B 인텔® FPGA IP 사용자 가이드 |
디자인 예제 사용자 가이드 | Agilex 7 | JESD204B 인텔® Agilex™ FPGA IP 설계 예 사용자 가이드 | JESD204C 인텔® Agilex™ FPGA IP 설계 예제 사용자 가이드 | F-Tile JESD204C 인텔® FPGA IP 설계 예제 사용자 가이드 | F-Tile JESD204B 인텔® FPGA IP 설계 예제 사용자 가이드 |
Stratix 10 | JESD204B 인텔® Stratix® 10 FPGA IP 설계 예 사용자 가이드 | JESD204C 인텔® Stratix® 10 FPGA IP 설계 예 사용자 가이드 | |||
Cyclone 10 | JESD204B 인텔® Cyclone® 10GX FPGA IP 설계 예 사용자 가이드 | ||||
Arria 10 | JESD204B 인텔® Arria® 10 FPGA IP 설계 예 사용자 가이드 | ||||
표준 | JESD204B 인텔® FPGA IP 디자인 예제 사용자 가이드: 인텔® Quartus® 프라임 스탠다드 에디션 |
6. 교육 과정 및 비디오
인텔® FPGA Technical Training
비디오 제목 |
설명 |
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이 온라인 과정은 JESD204B 인텔 FPGA IP 코어에 대한 폭넓은 개요를 제공합니다. 과정에서 사용되는 모든 이용 약관과 개념을 더 잘 이해하기 위해 JESD204B 인터페이스 사양의 관련 부분에 대한 논의를 시작하고 JESD204B 인텔 FPGA IP 코어의 중요한 기능 중 일부를 발표합니다. 마지막으로, 시스템의 데이터 흐름은 코어의 기능 세부 사항을 설명하는 데 사용됩니다. |
인텔® FPGA 빠른 비디오
비디오 제목 |
설명 |
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인텔® Agilex™ 7 FPGA F-Tile JESD204C 데모 비디오 | JESD204B/C 표준은 여러 세대의 인텔® FPGAs 지원되었습니다. JESD204C가 인텔® Agilex™ 7 FPGA 어떻게 작동하는지 이 데모를 시청하십시오. |
ADI(Analog Devices Inc.)의 AD9144 컨버터와 함께 인텔® Arria® 10 FPGA JESD204B 인텔 FPGA IP 코어의 상호 운용성에 대해 알아보십시오. |
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Stratix® V FPGA 인텔® FPGA JESD204B IP 코어로 ADI AD9680을 상호 운용하는 방법 |
하드웨어를 설정하고, 아날로그-디지털 컨버터를 구성하고, JESD204B 인텔 FPGA IP 코어를 구성하는 방법에 대한 단계별 가이드를 확인하십시오. |
하드웨어를 설정하고, 아날로그-디지털 컨버터를 구성하고, JESD204B 인텔 FPGA IP 코어를 구성하는 방법에 대한 단계별 가이드를 확인하십시오. |
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STRATIX V FPGA 인텔® FPGA JESD204B MegaCore로 TI DAC37J84를 상호 운용하는 방법 |
텍사스 인스트루먼트의 DAC37J84 컨버터와 함께 Stratix® V FPGA JESD204B 인텔 FPGA IP 코어의 상호 운용성에 대해 알아보십시오. |
JESD204B 표준 및 JESD204B 인텔 FPGA IP 솔루션에 대해 알아보십시오. 하드웨어에서 작동하는 설계 예제를 쉽게 만들 수 있는 방법을 알아보십시오. |
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텍사스 인스트루먼트의 DAC37J84 컨버터와 함께 Arria V FPGA JESD204B 인텔 FPGA IP 코어의 상호 운용성에 대해 알아보십시오. |
7. 디버그
지적 재산권(IP) 코어 릴리스 노트
추가 리소스
® 인텔 Agilex 7, 인텔® Stratix® 10, 인텔® Arria® 10, 인텔® Cyclone® 10 장치
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