문서 ID: 000075551 콘텐츠 형태: 문제 해결 마지막 검토일: 2018-09-11

이더넷 인텔® FPGA IP용 인텔® Stratix® 10, H-tile 하드 IP를 사용할 때 너무 큰 프레임 스트리핑으로 인해 사용자 로직에 유효하지 않은 프레임이 표시될 수 있습니다.

환경

  • 인텔® Quartus® Prime Pro Edition
  • 이더넷
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    중요 문제

    설명

    이더넷 인텔® FPGA IP RX MAC용 H-tile 하드 IP가 프레임 크기 >= 65536을 수신하고 enforce_max_frame_size이 활성화되면 RX MAC에서 사용자 로직으로의 프레임 출력이 max_rx_frame_size 설정에서 지정한 프레임 크기로 잘립니다. 두 번째 유효하지 않은 프레임은 RX MAC에서 바이트-65536에서 초대형 프레임의 끝까지 사용자 로직으로 출력됩니다.

    해결 방법

    이 정오표 문제에 사용할 수 있는 해결 방법이나 수정 사항이 없습니다.

    이 문제는 인텔® Quartus® Prime 소프트웨어의 향후 릴리스에서 수정될 예정입니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Stratix® 10 FPGA 및 SoC FPGA

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    보증 제외

    1

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