문서 ID: 000076312 콘텐츠 형태: 문제 해결 마지막 검토일: 2021-05-05

타이밍 분석기가 인텔® Arria® 10 네이티브 고정 소수점 DSP IP에서 최소 기간 타이밍 위반을 보고하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • 네이티브 고정 포인트 DSP 인텔® Arria® 10 FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    DSP 블록이 완전히 등록되지 않은 경우 최소 타이밍 기간 위반이 나타날 수 있습니다.

    해결 방법

    이 문제를 해결하려면 IP GUI를 사용하여 입력, 출력 및 파이프라인 레지스터를 활성화하여 인텔® Arria® 10 네이티브 고정 소수점 DSP IP를 사용할 때 타이밍이 충족되도록 합니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Arria® 10 FPGA 및 SoC FPGA

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