문서 ID: 000078002 콘텐츠 형태: 문제 해결 마지막 검토일: 2014-09-08

Arria® V GX/GT 장치에서 OBSAI 프로토콜을 구현할 때 어떤 조건에서 결정적 대기 시간 PHY가 rx_syncstatus 달성하지 못할 수 있습니까?

환경

    인텔® Quartus® II 소프트웨어
    Arria® V 트랜시버 네이티브 PHY 인텔® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
설명

Arria® V GX/GT 디바이스에서 Deterministic Latency PHY를 사용하여 OBSAI 프로토콜을 구현할 때 연결 프로세스 중에 IDLE, IDLE_ACK 및 IDLE_REQ 패턴이 전송될 때 rx_syncstatus 달성하지 못할 수 있습니다.

해결 방법

rx_patternalign 다시 트리거하거나 rx_digitalreset 어설션하여 동기화를 수행할 수 있습니다.

이는 다음 구성의 결정적 대기 시간 PHY에 적용됩니다.

  • 데이터 속도: 6.144Gbps
  • PMA-PCS 데이터 폭: 20비트

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Arria® V GX FPGA
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