문서 ID: 000078950 콘텐츠 형태: 문제 해결 마지막 검토일: 2011-10-12

Stratix V 장치를 대상으로 하는 VHDL 설계는 ModelSim-Altera 스타터 에디션 소프트웨어 버전 6.6c 및 6.6d로 시뮬레이션할 수 없습니다.

환경

  • 인텔® Quartus® II 구독 에디션
  • 시뮬레이션
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    중요 문제

    설명

    ModelSim-Altera 스타터 에디션 소프트웨어의 문제로 인해 버전 6.6c 및 6.6d, V 장치를 대상으로 하는 VHDL 디자인 Stratix 시뮬레이션할 수 없습니다. 이 문제는 ModelSim-Altera 영향을 미치지 않습니다. 에디션 소프트웨어. 이 문제로 인해 비슷한 오류가 발생할 수 있습니다. 다음을 수행합니다.

    # ALTERA version supports only a single HDL # ** Fatal: (vsim-3512) Instantiation of "stratixv_ds_coef_sel" failed. Unable to check out Verilog simulation license.

    해결 방법

    Verilog HDL로 디자인을 시뮬레이션하거나 ModelSim-Altera 에디션 소프트웨어 버전 6.6d.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    Stratix® V FPGA

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    보증 제외

    1

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