문서 ID: 000079092 콘텐츠 형태: 문제 해결 마지막 검토일: 2013-08-14

Qsys에서 구현할 때 ff_tx_crc_fwd 포트가 TSE IP에서 누락된 이유는 무엇입니까?

환경

    인텔® Quartus® II 구독 에디션
BUILT IN - ARTICLE INTRO SECOND COMPONENT
설명

Qsys 내에서 트리플 스피드 이더넷(TSE) IP를 사용할 때는 포트 ff_tx_crc_fwd 사용할 수 없습니다. 이 신호는 내부적으로 IP 내의 1'b0 값과 연결되어 있습니다.

그러나 CRC 계산 및 삽입은 tx_cmd_stat 레지스터의 OMIT_CRC 옵션을 통해 TX 데이터 경로에서 여전히 활성화되거나 비활성화될 수 있습니다(주소: 0x3A, bit 17).

해결 방법 Quartus® II 소프트웨어 버전 v13.0부터 Qsys는 모든 TSE IP 신호를 생성합니다.

관련 제품

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Cyclone® V E FPGA
Stratix® V E FPGA
Cyclone® V SX SoC FPGA
Cyclone® V ST SoC FPGA
Cyclone® V SE SoC FPGA
Cyclone® IV E FPGA
Arria® V SX SoC FPGA
Arria® V ST SoC FPGA
Cyclone® III LS FPGA
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Cyclone® III FPGA
Stratix® V GX FPGA
Cyclone® IV GX FPGA
Cyclone® V GX FPGA
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Stratix® V GS FPGA
Stratix® II GX FPGA
Stratix® II FPGA
Arria® V GX FPGA
Cyclone® II FPGA
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