문서 ID: 000079332 콘텐츠 형태: 제품 정보 및 문서 마지막 검토일: 2013-11-20

UniPHY 기반 메모리 컨트롤러에서 온칩 종료를 제거하려면 어떻게 합니까?

환경

BUILT IN - ARTICLE INTRO SECOND COMPONENT
설명

이 솔루션은 UniPHY 기반 메모리 컨트롤러를 사용하는 설계에서 온칩 종료(OCT)를 제거하는 단계를 설명합니다. 메모리 인터페이스 I/O에서 OCT를 제거하는 가장 큰 동기는 전원을 절약하는 것입니다. 명심해야 할 세 가지 사항이 있습니다.

  • 최소 300MHz 이상 작동하는 메모리 I/O에서 FPGA(다이 또는 온보드) 종료를 제거하지 마십시오.
  • 신호에 대한 종료를 mem_clk 제거하지 마십시오.
  • OCT를 제거한 후 신호 품질을 확인하기 위해 신호 무결성 시뮬레이션을 수행합니다.

아래 단계에서는 OCT를 제거하는 방법을 설명합니다. 다음 단계에 적용합니다.

  • Stratix® V, Arria® V 및 Cyclone® V용 DDR3
  • Stratix V 및 Arria V용 QDR II
  • Stratix V용 RLDRAM II

프로젝트를 수정하기 전에 오류 없이 프로젝트가 컴파일되었는지 확인하십시오.

  1. 를 엽니다. project_name>.qsf 파일. Quartus® II 설정 파일(.qsf) 또는 할당 편집기에서 종료 IO 할당을 제거하거나 설명합니다. 예를 들어, 다음 줄에 댓글을 달십시오.
    set_instance_assignment -name INPUT_TERMINATION "PARALLEL 50 OHM WITH CALIBRATION"
    set_instance_assignment -name OUTPUT_TERMINATION "SERIES 50 OHM WITH CALIBRATION”
    QSF 할당에 대해 설명하려면 줄 시작 부분에 파운드(#) 기호를 추가합니다.
  2. RLDRAM II 및 QDRII/QDRII 전용: QSF 제약조건을 제거합니다. set_instance_assignment -name TERMINATION_CONTROL_BLOCK”
  3. Quartus 컴파일을 시작합니다. 컴파일이 많은 오류와 함께 설계에 맞지 않습니다. "출력 버퍼 아톰"으로 시작하는 첫 번째 오류를 두 번 클릭하면 altdq_dqs2_stratixv.sv에서 출력 버퍼의 인스턴스화를 가리킵니다. 출력 버퍼 인스턴스화에서 다음 연결을 제거합니다.
    1. 병렬 테라마이네이션컨트롤
    2. 시리즈터미네이션컨트롤
    3. 동적터미네이션컨트롤
예를 들어, 변경
.parallelterminationcontrol (parallelterminationcontrol_in),
받는 사람
.parallelterminationcontrol (),
사용 중인 메모리 프로토콜에 따라 연결을 제거해야 하는 인스턴스가 두 개 이상 있을 수 있습니다. "출력 버퍼 아톰"으로 시작하는 모든 오류를 제거할 때까지 3단계를 반복합니다.
  • DDR2 및 DDR3 전용: altdq_dqs2_stratixv.sv를 엽니다. "stratixv_pseudo_diff_out"라는 인스턴스를 찾습니다. "dtcin"이 정의되어 있는 선을 설명합니다. 변경:
    .dtcin(delayed_oct),
    받는 사람
    //.dtcin(delayed_oct),

관련 제품

이 문서는 다음 항목에 적용됩니다. 15 제품

Stratix® V GX FPGA
Arria® V GX FPGA
Cyclone® V GT FPGA
Stratix® V GS FPGA
Stratix® V GT FPGA
Cyclone® V E FPGA
Cyclone® V GX FPGA
Stratix® V FPGA
Arria® V GT FPGA
Stratix® V E FPGA
Arria® V ST SoC FPGA
Arria® V SX SoC FPGA
Cyclone® V SE SoC FPGA
Cyclone® V ST SoC FPGA
Cyclone® V SX SoC FPGA

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