환경
BUILT IN - ARTICLE INTRO SECOND COMPONENT
설명
트리플 스피드 이더넷 MegaCore® 기능 사용자 가이드에 따르면 mdio_addr1 HW 리셋 값은 '1'입니다. 이 옵션은 MDIO 옵션이 켜져 있는 경우에만 적용됩니다. 트리플 스피드 이더넷 IP 인스턴스화에서 MDIO 옵션이 꺼진 경우 mdio_addr1 HW 재설정 값은 '0'입니다.
관련 제품
이 문서는 다음 항목에 적용됩니다. 28 제품
Cyclone® V GT FPGA
Cyclone® III FPGA
Stratix® V GX FPGA
Cyclone® IV GX FPGA
Cyclone® V GX FPGA
Cyclone® II FPGA
Stratix® V GS FPGA
Arria® V GZ FPGA
Stratix® II GX FPGA
Stratix® II FPGA
Arria® V GX FPGA
Stratix® V GT FPGA
Arria® V GT FPGA
Stratix® III FPGA
Stratix® IV GX FPGA
Arria® II GX FPGA
Arria® II GZ FPGA
Stratix® IV GT FPGA
Cyclone® V E FPGA
Stratix® V E FPGA
Arria® GX FPGA
Cyclone® V SX SoC FPGA
Cyclone® V ST SoC FPGA
Cyclone® V SE SoC FPGA
Cyclone® IV E FPGA
Arria® V ST SoC FPGA
Cyclone® III LS FPGA
Stratix® IV E FPGA