문서 ID: 000080422 콘텐츠 형태: 문제 해결 마지막 검토일: 2019-07-08

이더넷 인텔® FPGA IP 코어용 H-타일 하드 IP가 설계 예제를 생성하지 못한 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • 이더넷 인텔® FPGA IP용 H-tile 하드 IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    중요 문제

    설명

    인텔® Quartus® Prime Pro Edition 소프트웨어 버전 19.2의 문제로 인해 대상 개발 키트가 NONE로 설정된 경우 이더넷 인텔® FPGA IP 코어용 H-타일 하드 IP가 설계 예를 생성하지 못합니다.

    해결 방법

    인텔® Quartus® Prime Pro Edition 소프트웨어 버전 19.2에서 이 문제를 해결하려면 Target 개발 키트를 프로젝트 장치에 가장 가까운 장치가 있는 키트로 설정합니다.

    이 문제는 인텔® Quartus® Prime Pro Edition 소프트웨어 버전 19.3부터 해결됩니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Stratix® 10 FPGA 및 SoC FPGA

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    1

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