문서 ID: 000083323 콘텐츠 형태: 문제 해결 마지막 검토일: 2018-08-30

Arria® 10 FPGA 장치에 대해 100G Interlaken IP 예제 설계가 생성될 때 Cadence* Xcelium* 시뮬레이션 스크립트가 생성됩니까?

환경

    인텔® Quartus® Prime Pro Edition
    인텔® FPGA IP 100G Interlaken IP-ILKN/100G
BUILT IN - ARTICLE INTRO SECOND COMPONENT
설명

아니요. Cadence* Xcelium* 시뮬레이션 스크립트는 10개 FPGA 장치를 대상으로 하는 100G Interlaken IP 예제 설계Arria® 대해 생성되지 않습니다. Arria® 10 FPGA 장치를 대상으로 할 때 Modelsim*, NCSim* 및 VCS*에서 100G Interlaken 예제 설계 테스트벤치를 시뮬레이션하기 위해 스크립트가 생성됩니다.

해결 방법

이 문제에 대한 해결 방법은 없습니다.

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인텔® Arria® 10 FPGA 및 SoC FPGA

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