문서 ID: 000086072 콘텐츠 형태: 문제 해결 마지막 검토일: 2021-04-21

eSRAM 인텔 Agilex® 7 FPGA IP가 최대 성능 사양을 충족하지 못하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    인텔 Quartus® Prime Pro Edition 소프트웨어 버전 19.3 이상에서 문제가 발생하여 eSRAM 인텔 Agilex® 7 FPGA IP는 보류 위반으로 인해 최대 성능 사양을 충족하지 못할 수 있습니다.

    해결 방법

    이 문제를 해결하려면 eSRAM IP 인스턴스에 "(* altera_attribute = "이름 HYPER_REGISTER_DELAY_CHAIN 100"*)를 추가하여 설계 파일을 수정합니다.

    예를 들어:

    (* altera_attribute = "이름 HYPER_REGISTER_DELAY_CHAIN 100"*) esram esram_inst(
    .esram0_ram_input_clk(clk_500),
    ......

    이 문제는 인텔® Quartus® Prime Pro Edition 소프트웨어 버전 21.2부터 해결됩니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Agilex™ FPGAs 및 SoC FPGAs

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