문서 ID: 000086682 콘텐츠 형태: 제품 정보 및 문서 마지막 검토일: 2017-04-04

Quartus Prime 프로젝트에 Arria 10개의 외부 메모리 인터페이스 IP가 포함되어 있을 때 IO_AUX 및 RST_SRC_ID 피터 오류를 해결하려면 어떻게 합니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • HPS 인텔® Arria® 10 FPGA IP용 외부 메모리 인터페이스
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    잘못된 Arria® 10개의 EMIF IP global_reset_n 포트 신호 연결 또는 시스템 소스 및 프로브(ISSP)를 활성화하면 이러한 유형의 오류가 발생할 수 있습니다.

    오류(12934년): Fitter가 EMIF/PHYLite 시스템을 배치할 수 없습니다.

    오류(14566): Fitter는 기존 제약 조건(1 IO_AUX)과의 충돌로 인해 1개의 주변 구성 요소를 배치할 수 없습니다.

    오류(175020): Fitter는 이 유형의 로직에 대한 유효한 위치가 없기 때문에 Arria 10개의 외부 메모리 인터페이스 ed_synth_altera_emif_ 지역 의 일부인 로직 IO_AUX 배치할 수 없습니다.
        
    오류(175005): <value> (영향을 받는 위치 1개)의 RST_SRC_ID 있는 위치를 찾을 수 없습니다.

    해결 방법

    이러한 오류 메시지와 해상도의 일반적인 원인은 다음과 같습니다.

    1) Quartus® Prime 프로젝트에는 동일한 I/O 열의 I/O 뱅크에 배치되지만 global_reset_n 포트에 연결된 다른 리셋 신호가 있는 여러 외부 메모리 인터페이스가 포함되어 있습니다.

    해상도: 동일한 I/O 열에 I/O 뱅크에 배치된 여러 인터페이스에는 global_reset_n 포트에 공통 리셋 신호가 연결되어 있어야 합니다.


    2) Quartus Prime 프로젝트가 활성화되어 ALTERA_EMIF_ENABLE_ISSP. 일반적으로 프로젝트에 인스턴스화된 Arria 10개의 EMIF 예제 설계가 여러 개 있는 경우 발생합니다.
    예를 들어 qsf 파일 제약 조건은
    set_global_assignment -name VERILOG_MACRO "ALTERA_EMIF_ENABLE_ISSP=1"

    해결 방법: 위의 qsf 제약 조건을 제거하고 Arria 10개의 외부 메모리 인터페이스 IP 진단 탭 -> 예제 설계 -> 인-시스템 소스 및 프로브 활성화 옵션을 선택하지 마십시오.


    위에 표시된 지침에 따라 여전히 피터 오류가 나타나는 경우 메모리 인터페이스 신호가 핀 배치 지침을 충족하는지 확인하십시오.
    권장되는 출발점은 최소한의 배치 제약 조건을 사용하고 Quartus fitter가 나중에 핀아웃을 구체화하기 전에 나머지 인터페이스 신호를 배치하도록 하는 것입니다.

    권장되는 최소 배치 제약 조건은 다음과 같습니다.

    • 주소/명령 신호에 대해 선택된 I/O 은행의 주소 신호 1개, PLL 참조 클럭 및 RZQ 핀 1개.
    • 메모리 데이터 버스 신호에 대해 선택된 I/O 은행의 DQS 신호입니다.


    핀 배치에 대한 자세한 내용은 외부 메모리 인터페이스 핸드북의 다음 섹션을 참조하십시오.
    볼륨 2 Chapter 1 - Arria 10 외부 메모리 인터페이스 IP에 대한 지침
    볼륨 3 2장 - DDR4에 대한 외부 메모리 인터페이스 구현 예시(다른 메모리 인터페이스 프로토콜에 유사한 규칙이 적용됨).

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Arria® 10 FPGA 및 SoC FPGA

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