문서 ID: 000086897 콘텐츠 형태: 문제 해결 마지막 검토일: 2018-07-26

인텔® Stratix® 10 MX 디바이스가 구성에 실패하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • 고대역폭 메모리(HBM2) 인터페이스 인텔® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    인텔® Quartus® Prime Pro Software 버전 18.0의 문제로 인해 프로젝트에 HBM2 IP가 없더라도 UIB(Universal Interface Block) PLL 참조 클럭이 실행되지 않으면 인텔® Stratix® 10 MX 디바이스가 구성에 실패합니다.

    해결 방법

    UIB PLL 참조 클럭을 인텔 Stratix 10 MX 디바이스에 연결하고 인텔® Stratix® 10 디바이스 제품군 핀 연결 지침에 표시된 필수 사양을 충족하는 클럭을 제공합니다.

    이 문제는 인텔® Quartus® Prime Pro Edition 소프트웨어 버전 18.0.1에서 수정되었습니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Stratix® 10 MX FPGA

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