문서 ID: 000086901 콘텐츠 형태: 문제 해결 마지막 검토일: 2018-04-06

인텔® Stratix® 10 FPGA 외부 메모리 인터페이스 IP에는 주기적인 OCT 재 보정이 필요합니까?

환경

    인텔® Quartus® Prime Pro Edition
    외부 메모리 인터페이스 인텔® Stratix® 10 IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
설명

인텔® Stratix® 10 FPGA 외부 메모리 인터페이스 IP는 주기적인 온칩 종료(OCT) 재 보정이 필요하지 않습니다.

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인텔® Stratix® 10 FPGA 및 SoC FPGA

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