fPLL 지적 재산권(IP) GUI에서 피드백 보상 결합으로 설정된 다운스트림 계단식 PLL 및 운영 모드를 모두 활성화하는 인텔® Arria® 10개 장치에서 트랜시버(XCVR) 분수 PLL(fPLL)을 구현할 때 인텔® Quartus® Prime Software에서 이 오류가 나타날 수 있습니다.
이 오류를 방지하려면 인텔® Arria® 10 장치 데이터시트를 참조하고 fPLL의 입력 주파수가 최소 및 최대 fCASC_PFD 사양(표 30) 내에 있는지 확인하고 출력 주파수가 지원되는 출력 주파수(표 19)와 동일하거나 그 이상인지 확인하십시오.