문서 ID: 000088867 콘텐츠 형태: 정오표 마지막 검토일: 2024-11-23

PTP가 활성화된 F-Tile 이더넷 FPGA 하드 IP와 FHT PMA 유형이 하드웨어에서 o_rx_pcs_ready 어설션하지 못하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    Quartus® Prime Pro Edition 소프트웨어 v21.4의 문제로 인해 FHT PMA 유형의 F-Tile 이더넷 FPGA 하드 IP가 하드웨어에서 o_clk_rec_div (RX 복구 클럭)을 출력하지 못합니다.

    고급 타임스탬프 정확도 모드에는 o_clk_rec_div 클럭이 필요하므로 IP는 링크를 설정할 수 없으며 o_rx_pcs_ready 어설션되지 않습니다.

    해결 방법

    Quartus® Prime Pro Edition 소프트웨어 v21.4에서 이 문제를 해결하려면 o_clk_rec_div 클럭이 필요하지 않은 기본 타임스탬프 정확도 모드를 선택합니다

    추가 정보

    이 문제는 Quartus® Prime Pro Edition 소프트웨어 버전 22.1부터 해결됩니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Agilex™ I-시리즈 FPGAs 및 SoC FPGAs

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