문서 ID: 000092786 콘텐츠 형태: 문제 해결 마지막 검토일: 2022-12-14

PCI Express*용 P-Tile Avalon® 스트리밍 인텔® FPGA IP 사용할 때 제거 타이밍 위반이 발생하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • 인터페이스
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    인텔® Quartus® Prime Pro Edition 소프트웨어 버전 22.2의 문제로 인해 PCI Express*용 P-Tile Avalon® 스트리밍 인텔® FPGA IP 사용할 때 "*|intel_pcie_ptile_ast_0|soft_logics|rst_ctrl|p*_reset_status_s_q" 에서 제거 타이밍 위반이 발생할 수 있습니다.

    해결 방법

    이 문제는 인텔® Quartus® Prime Pro Edition 소프트웨어 버전 22.3 이후에서 해결되었습니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 2 제품

    인텔® Stratix® 10 DX FPGA
    인텔® Agilex™ F-시리즈 FPGAs 및 SoC FPGAs

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