문서 ID: 000094550 콘텐츠 형태: 문제 해결 마지막 검토일: 2023-11-27

10G 비동기 클러킹 모드에서 이더넷 서브시스템 인텔® FPGA IP의 PTP 패킷 파서에 대한 AXI-Lite 레지스터 액세스가 실패하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    인텔® Quartus® Prime Pro Edition 소프트웨어 버전 23.1의 문제로 인해 AXI-ST 데이터 경로 클럭이 AXI-Lite 클럭보다 느리면 이더넷 서브시스템 인텔® FPGA IP의 PTP 패킷 파서에 대한 AXI-lite 레지스터 액세스가 10G 비동기 클러킹 모드에서 실패합니다.

    해결 방법

    이 문제를 해결하려면 AXI-Lite 클럭이 AXI-ST 데이터 경로 클럭보다 느려야 합니다.
    이 문제는 인텔® Quartus® Prime Pro Edition 소프트웨어의 향후 릴리스에서 수정될 예정입니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 2 제품

    인텔® Agilex™ F-시리즈 FPGAs 및 SoC FPGAs
    인텔® Agilex™ I-시리즈 FPGAs 및 SoC FPGAs

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