문서 ID: 000096873 콘텐츠 형태: 정오표 마지막 검토일: 2024-11-12

F-Tile 이더넷 FPGA 하드 IP의 PAM4 변형에 대한 하드웨어에서 o_rx_pcs_ready 신호가 어설션되지 않는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    Quartus® Prime Pro Edition 소프트웨어 버전 23.3 이하의 문제로 인해 변형이 312.5MHz PMA 참조 클럭과 Quartus 설정 파일(QSF) 할당 VSR_MODE_LOW_LOSS 모두 사용하는 경우 F-Tile 이더넷 FPGA 하드 IP의 PAM4 변형에 대한 하드웨어 에서 o_rx_pcs_ready 신호가 어설션되지 않습니다.

    해결 방법

    이 문제를 해결하려면 QSF 할당 VSR_MODE_LOW_LOSS 해제하십시오.
    이 문제는 Quartus® Prime Pro Edition 소프트웨어의 향후 릴리스에서 해결될 예정입니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® Agilex™ FPGAs 및 SoC FPGAs

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