문서 ID: 000097884 콘텐츠 형태: 문제 해결 마지막 검토일: 2024-01-16

F-Tile 3배속 이더넷 인텔® FPGA IP 설계 사례를 시뮬레이션할 때 Synopsys VCS* 시뮬레이터가 실패하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • 3배속 이더넷 인텔® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    인텔® Quartus® Prime Pro Edition 소프트웨어 버전 23.2 및 23.3의 문제로 인해 F-Tile 3배속 이더넷 인텔® FPGA IP 설계 사례를 대상으로 할 때 Synopsys VCS* 시뮬레이터가 실패합니다.

    해결 방법

    이 문제를 해결하려면 F-Tile 트리플 스피드 이더넷 인텔® FPGA IP 설계 예에 대해 생성된 Synopsys VCS* 시뮬레이션 스크립트(run_vcs.sh)의 USER_DEFINED_ELAB_OPTIONS 시뮬레이션 스위치 "-debug_region=encrypt"를 추가하십시오.

    이 문제는 인텔® Quartus® Prime Pro Edition 소프트웨어 버전 23.4에서 해결되었습니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 2 제품

    인텔® Agilex™ FPGAs 및 SoC FPGAs
    인텔® Agilex™ I-시리즈 FPGA 개발 키트

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