문서 ID: 000099410 콘텐츠 형태: 문제 해결 마지막 검토일: 2024-08-01

F-Tile 저지연 이더넷 10G MAC FPGA IP가 대상 개발 키트를 P-Tile 및 E-Tile 보드로 표시하는 이유는 무엇입니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • 저지연 이더넷 10G MAC 인텔® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    Quartus® Prime Pro Edition 디자인 소프트웨어 버전 24.2의 문제로 인해 F-Tile 저지연 이더넷 10G MAC FPGA IP GUI 예제 설계 탭은 대상이 F-타일 기반 장치일 때 대상 보드를 Agilex™ 7 FPGA F-시리즈 개발 키트(프로덕션 P-타일 및 E-타일)로 표시합니다.

    해결 방법

    이 문제는 Quartus® Prime Pro Edition 디자인 소프트웨어의 향후 버전에서 해결될 예정입니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 2 제품

    인텔® Agilex™ F-시리즈 FPGAs 및 SoC FPGAs
    인텔® Agilex™ I-시리즈 FPGAs 및 SoC FPGAs

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