인텔® FPGA 도식 검토 워크시트

인텔® FPGA 회로도를 검토하고 인텔의 지침을 준수하는 데 도움이 되는 도식 검토 워크시트를 제공합니다. 이러한 워크시트는 각 장치 핀 연결 지침 및 개략을 마무리할 때 고려해야 하는 보드 레벨 핀 연결에 적용되는 기타 참조된 인텔 FPGA 문서를 기반으로 합니다. 도식 검토 워크시트는 아래 표에 연결되어 Microsoft* Office Word 문서 형식으로 다운로드합니다.

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경계 스캔 테스트에 대한 자세한 내용은 인텔 BSDL 지원 페이지를 참조하십시오.

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