Verilog HDL: 애드러/서브트랙터

author-image

기준

이 예에서는 Verilog HDL에서 2개의 입력, 8비트 애드러/서브트랙터 설계에 대해 설명합니다. 설계 장치는 add_sub 입력 포트를 통해 추가 작업과 빼기 작업 간에 동적으로 전환됩니다.

그림 1. 애드러/서브트랙터 최상위 다이어그램.

이 예에 사용된 파일을 다운로드하십시오.

이 페이지의 콘텐츠는 원본 영어 콘텐츠에 대한 사람 번역 및 컴퓨터 번역의 조합으로 완성되었습니다. 이 콘텐츠는 편의와 일반적인 정보 제공을 위해서만 제공되었으며, 완전하거나 정확한 것으로 간주되어선 안 됩니다. 이 페이지의 영어 버전과 번역 간 모순이 있는 경우, 영어 버전이 우선적으로 적용됩니다. 이 페이지의 영어 버전을 확인하십시오.