VHDL: 단일 포트 ROM

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기준

이 예에서는 VHDL에서 읽기 작업을 위해 하나의 주소 포트가 있는 256비트 x 8비트 단일 포트 ROM 설계에 대해 설명합니다. 합성 도구는 HDL 코드에서 ROM 설계를 감지하고 대상 장치 아키텍처에 따라 altsyncram 또는 lpm_rom 메가 기능을 자동으로 추론할 수 있습니다.

그림 1. 단일 포트 rom 최상위 다이어그램

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