트랜시버 툴킷
더 빠른 보드 가져오기를 위한 실시간 트랜시버 액세스
트랜시버 툴킷은 시스템 콘솔 기술을 사용하여 FPGA 보드 설계자가 시스템에서 트랜시버 링크 신호 무결성을 실시간으로 검증하고 보드 가져오기 시간을 개선할 수 있도록 지원합니다. Transceiver Toolkit을 사용하여 보드 설계를 검증하기 위해 목표 데이터 속도로 여러 링크를 동시에 실행하면서 비트 오류율(BER)을 테스트합니다. 다른 테스트 메트릭을 사용하여 결과를 정량화하는 동안 트랜시버 아날로그 설정을 조정하여 최적의 링크 성능을 제공합니다. Transceiver Toolkit GUI의 링크 테스트를 사용하여 하나 이상의 보드에서 여러 장치를 동시에 테스트합니다. 인텔 Agilex® 7, 인텔® Stratix® 10, Stratix® V FPGAs 지원하며 신호 전송 견고성을 위한 적응형 균등화(AEQ) 및 의사 결정 피드백 균등화(DFE)가 포함됩니다. 최신 추가 사항은 인텔 Agilex® 7 트랜시버 타일에 대한 지원을 포함합니다.
트랜시버 툴킷 기능
- FPGA 보드 디자이너에게 트랜시버 설정에 실시간으로 액세스하고 보드 가져오기 시간을 개선합니다.
- 의사 랜덤 바이너리 시퀀스(PRBS) 패턴 생성기 및 검사기를 통해 비트 오류율 테스트(BERT) 기능을 제공합니다.
- 여러 채널을 동시에 테스트하는 동안 상태를 모니터링하고 추적할 수 있는 채널 관리자 인터페이스 포함
- 하나 이상의 보드에서 여러 장치 간에 링크 테스트를 실행합니다.
- Eye Viewer를 통해 신호 눈의 폭과 높이를 결정합니다(선택한 장치에서 사용 가능)
- AEQ 및 DFE를 포함한 신호 무결성 하드웨어 기능에 대한 액세스를 제공합니다.
- AutoSweep 기능에 새로운 인터벌 스테핑 기능을 제공하여 PMA(물리적 중간 부착물) 아날로그 설정 조합을 빠르게 테스트하여 특정 트랜시버 링크에 적합한 최적의 세트를 찾을 수 있습니다.
- 신호 무결성 결과를 쉽게 비교할 수 있는 저장 및 로드 지원으로 수동 PMA 설정 제어 및 테스트 플롯 관리와 Eye Viewer 통합을 제공합니다.
- Eye Viewer 데이터를 캡처하는 동안 PMA 설정을 자동으로 스윕할 수 있는 새로운 "AutoSweep 및 Eye Viewer" 모드를 제공합니다.
- Stratix® V FPGAs 트리거된 적응 모드 DFE를 지원하고 인텔® Stratix® 10개 FPGAs 위한 트리거 및 연속 DFE 모드를 지원합니다.
표 1. 트랜시버 툴킷 장치 지원
장치 제품군 | |||||||||||
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Cyclone® V |
인텔® Cyclone® 10 |
Arria® II GX |
Arria® V GX/GT |
Arria® V GZ |
인텔® Arria® 10GX/SX/GT |
Stratix® IV GX/GT |
Stratix® V GX |
Stratix® V GT |
인텔® Stratix® 10GX/SX/MX/TX |
® 인텔 Agilex 7 FPGA I 시리즈 |
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실시간 액세스 |
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내장 BERT 기능 |
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멀티채널 테스트 |
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여러 장치 링크 테스트 |
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Eye Viewer – 신호 눈 폭 지원 |
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Eye Viewer – 신호 눈 높이 지원 |
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AEQ |
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Dfe |
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