인텔® Stratix® 10 MX FPGA이 구성되면 인텔® MAX® 10 FPGA 작동하지 않을 수 있습니다.
인텔® Quartus® Prime Programmer로 JTAG를 스캔하기 전에 개발 키트 의 SW2를 다음 설정으로 설정하십시오.
이를 통해 사용자는 인텔® MAX® 10 FPGA에 안정적으로 액세스하여 프로그래밍된 데이터를 검사할 수 있습니다.
Bit1: 열기(꺼짐 - 온보드 인텔® FPGA 다운로드 케이블)
Bit2: 열림(꺼짐 - 인텔® MAX®10 JTAG IN)
Bit3: 닫힘(켜짐 - PCIe* 루트 포트 JTAG 꺼짐)
Bit4: 닫힘(켜짐 - 인텔® Stratix® 10MX JTAG 꺼짐)
이 설정은 JTAG에서 인텔® Stratix®10을 제거하고 검사가 성공합니다.