Quartus® II 소프트웨어 버전 12.1의 문제로 인해 IRQ Clock Crosser Logic을 활용하는 Qsys 시스템을 생성하는 동안 이 오류가 발생할 수 있습니다.
이 문제를 해결하려면 다음 단계를 따르십시오.
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텍스트 편집기에서 Quartus II 설치 디렉토리에 있는 altera_irq_clock_crosser_hw.tcl 파일을 엽니다.
<Quartus II 설치 디렉토리>\ip\altera\merlin\altera_irq_clock_crosser -
"set_module_property SIMULATION_MODEL_IN_VERILOG true" 줄을 제거합니다.
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"add_file altera_irq_clock_crosser.sv {SYNTHESIS SIMULATION}" 줄을 추가합니다.
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파일을 저장하고 Qsys 시스템을 재생성합니다.
이 문제는 Quartus II 소프트웨어 버전 13.0 이상에서 해결되었습니다.