중요 문제
Quartus II 소프트웨어는 다음에 대한 타이밍 분석을 수행하지 않습니다. Cyclone IV GX × 변형의 FPGA 패브릭; 결과적으로 변형 타이밍 분석에 실패하는 것은 식별되지 않습니다.
이 문제는 Cyclone IV GX 장치의 × 변형에 영향을 줍니다.
필요한 클럭 제약 조건을 수동으로 생성할 수 있습니다. 방정식을 제공합니다. 이 제약 조건의 경우. 이 방정식에서 <n>은 125에 대해 8.000입니다. MHz 응용 프로그램 클록이고 62.5MHz 응용 프로그램 클록의 경우 16입니다.
# create_clock -name {core_clk_out} -period
<n> -waveform { 0.000 8.000 } [get_nets {*altpcie_hip_pipen1b_inst
| core_clk_out~clkctrl}] |
이 문제는 Quartus II 소프트웨어 버전 10.1에서 해결되었습니다.