문서 ID: 000078675 콘텐츠 형태: 문제 해결 마지막 검토일: 2014-12-31

322 MHz 참조 클럭이 있는 낮은 지연 시간 40-100GbE IP 코어 타겟팅 Stratix V 장치는 RX MAC 클럭 주파수가 잘못되었습니다.

환경

  • 인텔® Quartus® II 구독 에디션
  • 이더넷
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    중요 문제

    설명

    LL 40-100GbE 매개변수 편집기에서 가능한 두 가지 값을 제공합니다. PHY 참조 주파수 매개변수에 대한 것입니다. 두 값 모두 312.5 MHz의 clk_rxmac 주파수를 생성해야 합니다. 40GbE 변형 및 100GbE 변형에 대한 390.625 MHz.

    그러나 IP 코어 변형에는 다음 속성이 포함됩니다. clk_rxmac 주파수는 다릅니다.

    • 대상 장치 제품군은 Stratix V 장치입니다. 가족.
    • PHY 참조 주파수 매개변수는 값은 322.265625 MHz입니다.
    해결 방법

    이 문제에는 해결 방법이 없습니다.

    이 문제는 지연 시간 부족의 향후 버전에서 해결됩니다. 40Gbps 및 100Gbps 이더넷 MAC 및 PHY MegaCore 기능.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    Stratix® V FPGA

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    1

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