문서 ID: 000081470 콘텐츠 형태: 문제 해결 마지막 검토일: 2011-11-15

LVDS 채널에 대한 PLL 공유 문제

환경

  • 인텔® Quartus® II 구독 에디션
  • 이더넷
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    중요 문제

    설명

    LVDS I/O가 포함된 여러 PMA 블록을 포함하는 설계에서, 다양한 트리플 스피드 이더넷 메가코어 기능의 LVDS 채널 공통 PLL을 공유하지 못합니다.

    이 문제는 Stratix II를 포함하는 설계에 영향을 Stratix II GX, Stratix III 및 Stratix IV E/GX 장치 제품군.

    해결 방법

    해결 방법이 없습니다. 이 문제는 트리플 스피드 버전 11.0에서 해결되었습니다. 이더넷 메가코어 기능.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 1 제품

    인텔® 프로그래밍 가능 장치

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