PCI Express* 버전 18.1용 인텔® Stratix® 10 Avalon -ST 및 단일 루트 I/O 가상화(SR-IOV) 인터페이스의 문제로 인해 Windows* OS에서 설계 예제를 생성할 때 이 오류가 발생할 수 있습니다.
오류: add_fileset_file: 이러한 파일 /0002_pcie_s10_hip_ast_0_gen/ip/pcie_example_design/pcie_example_design_DUT/altera_xcvr_fpll_s10_htile_181/sim/docs/pcie_example_design_DUT_altera_xcvr_fpll_s10_htile_181_rrbjwya_parameters.csv/pcie_example_design_DUT_altera_xcvr_fpll_s10_htile_181_rrbjwya_parameters.csv 없음
이 문제를 해결하려면 Linux OS에서 예제 디자인을 생성하십시오.
이 오류는 인텔® Quartus® Prime Pro Edition 소프트웨어의 향후 릴리스에서 수정될 예정입니다.