문서 ID: 000083299 콘텐츠 형태: 문제 해결 마지막 검토일: 2012-07-06

Arria V 및 Arria V GT 설계 시간 시간 분석기에서 보류 시간 요구 사항 실패

환경

  • 인텔® Quartus® II 구독 에디션
  • 이더넷
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    중요 문제

    설명

    이 errata는 트리플 스피드 이더넷 MegaCore 기능에 영향을 미칩니다.

    Arria V 및 Arria V GT 24채널 디자인을 대상으로 하는 설계 타임퀘스트 타이밍 분석기에서 LVDS I/O 장애 시간 요구 사항을 충족합니다.

    이 문제는 Arria V 및 Arria 대상으로 하는 모든 설계에 영향을 미칩니다. V GT 24채널 디자인 및 LVDS I/O.

    해결 방법

    시드 스위핑을 수행하여 보류 시간 요구 사항을 통과하십시오. 이 문제는 향후 트리플 스피드 이더넷 버전에서 해결될 것입니다. MegaCore 기능.

    관련 제품

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    인텔® 프로그래밍 가능 장치

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