중요 문제
이 문제는 DDR3 제품에 영향을 미칩니다.
분기 속도를 시뮬레이션할 때 시뮬레이션 오류가 발생할 수 있습니다. VHDL 및 ModelSim을 사용한 DDR3 설계, 탁구 PHY 활성화 캘리브레이션 모드를 빠른 또는 전체로 설정합니다.
이 문제의 해결 방법은 다음 중 하나를 수행하는 것입니다. 교정 모드를 건너뛰도록 설정합니다. VHDL 대신 Verilog를 사용하십시오. 또는 다른 시뮬레이터를 사용하십시오.
이 문제는 향후 릴리스에서 해결될 것입니다.