문서 ID: 000086105 콘텐츠 형태: 문제 해결 마지막 검토일: 2017-07-25

HPS I2C 컨트롤러의 SCL 및 SDA 낙하 시간을 독립적으로 설정할 수 있습니까?

환경

  • 인텔® Quartus® Prime Pro Edition
  • HPS 인텔® Arria® 10 FPGA IP용 외부 메모리 인터페이스
  • HPS 인텔® Arria® 10 FPGA IP용 외부 메모리 인터페이스
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    설명

    HPS I2C 컨트롤러는 SCL 및 SDA 낙하 시간 구성 기능을 지원합니다.

    해결 방법

    Linux OS에서 구성을 구현하는 방법에 대해서는 https://github.com/altera-opensource/linux-socfpga/commit/7d0429364bf0c0e69bf192362d85076e6ee9abd7 링크를 참조하십시오.

    디자이너는 다음과 같은 dts 파일에서 SCL 및 SDA 낙하 시간 매개변수를 구성할 수 있습니다.
     i2c-sda-falling-time-ns = ; boardinfo */에서 추가된 /*
    i2c-scl-falling-time-ns = ; boardinfo */에서 추가된 /*

    SCL 및 SDA 낙하 시간 구성 정보는 인텔 Arria 10 하드 프로세서 시스템 기술 참조 매뉴얼 에 추가되었습니다.

    관련 제품

    이 문서는 다음 항목에 적용됩니다. 7 제품

    Cyclone® V SX SoC FPGA
    Cyclone® V ST SoC FPGA
    Cyclone® V SE SoC FPGA
    Arria® V SX SoC FPGA
    Arria® V ST SoC FPGA
    인텔® Arria® 10 SX SoC FPGA
    인텔® Stratix® 10 SX SoC FPGA

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    보증 제외

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