VHDL: 듀얼 포트 ROM

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이 예에서는 VHDL에서 읽기 작업을 위한 두 개의 주소 포트가 있는 256비트 x 8비트 듀얼 포트 ROM 설계에 대해 설명합니다. 합성 도구는 HDL 코드에서 ROM 설계를 감지하고 대상 장치 아키텍처에 따라 altsyncram 또는 lpm_rom 메가 기능을 자동으로 추론할 수 있습니다.

그림 1. 듀얼 포트 ROM 최상위 다이어그램.

이 예에 사용된 파일을 다운로드하십시오.

이 설계의 사용은 인텔® 설계 예시 라이센스 계약의이용 약관에 따라 달라질 수 있습니다.

표 1. 듀얼 포트 ROM 포트 목록

포트 이름 유형 설명
addr_a[7:0], addr_b[7:0] 입력 포트 A 및 포트 B에 대한 8비트 읽기 주소 입력
Clk 입력 클럭 입력
q_a[7:0], q_b[7:0] 출력 포트 A 및 포트 B용 8비트 데이터 출력

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